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  1. module rom(
  2.         input [15:0] addr,
  3.         output reg [7:0] data,
  4.         input ce_n
  5. );
  6.  
  7.         always @*
  8.         begin
  9.                 if( ce_n )
  10.                         data <= 8'bZZZZZZZZ;
  11.                 else
  12.                 case(addr)
  13.                         16'h0000: data<=8'h21;
  14.                         16'h0001: data<=8'h00;
  15.                         16'h0002: data<=8'h00;
  16.                         16'h0003: data<=8'h11;
  17.                         16'h0004: data<=8'h00;
  18.                         16'h0005: data<=8'h80;
  19.                         16'h0006: data<=8'h01;
  20.                         16'h0007: data<=8'h0e;
  21.                         16'h0008: data<=8'h00;
  22.                         16'h0009: data<=8'hed;
  23.                         16'h000a: data<=8'hb0;
  24.                         16'h000b: data<=8'hc3;
  25.                         16'h000c: data<=8'h00;
  26.                         16'h000d: data<=8'h80;
  27.  
  28.                         default: data<=8'hFF;
  29.                 endcase
  30.  
  31.         end
  32.  
  33.  
  34.  
  35.  
  36. endmodule
  37.  
  38.